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[ modifier | modifier le code] Comparateur de Phase à bascule JK. Ce comparateur travaille sur fronts montants. C'est la raison pour laquelle les entrées peuvent ne pas être symétriques. Quand les entrées sont en opposition de phase, la tension de sortie moyennée par un filtrage, converge vers zéro si la bascule est polarisée entre les tensions ( -1, +1). Quand les deux signaux d'entrée ont un décalage de phase de 360 degrés, la tension moyenne de sortie atteint son maximum (ici +1), et quand il n'y a pas de déphasage entre les deux entrées, la tension de sortie atteint son minimum, (ici -1). La bascule JK n'est pas capable de faire office de détecteur de fréquence, ce n'est qu'un détecteur de phase. Comparateur de phase à multiplieur de Gilbert. [ modifier | modifier le code] Comparateur de Phase à multiplieur de Gilbert. Le multiplicateur de Gilbert peut servir de comparateur de phase. En effet, si les deux signaux d'entrée sont à la même fréquence, la sortie (préalablement filtrée) sera proportionnelle à la différence de phase selon.
LTspice IV Simulation avec LTspice IV Boucle verrouillage de phase: Etude de la PLL analogique, plages de capture et de verrouillage 1. Saisie du schma Edit -> Component: modulate (VCO linaire) Value: mark=20000 space=10000 0 V donne 10 kHz 1 V donne 20 kHz 0, 1 V donne 11 kHz -0, 1 V donne 9 kHz -1 V donne 0 Hz... La sortie du VCO est sinusodale (amplitude 1 V). Edit -> Component: voltage (source de tension) Value: PULSE(0. 1 -0. 1 10m 1n 1n) Le signal d'entre (Vin) est donc sinusodal, d'amplitude 1 V: - frquence 11 kHz de 0 10 ms (0, 1 V en entre du VCO) - frquence 9 kHz de 10 20 ms (-0, 1 V en entre du VCO) La boucle verrouillage de phase (PLL: Phase Lock Loop) est un asservissement de phase. La PLL est constitue de 3 lments: un multiplieur (comparateur de phase) un filtre passe-bas (R1 et C1, constante de temps 0, 47 ms) un oscillateur command en tension (VCO: Voltage Controlled Oscillator) Le multiplieur est obtenu de la manire suivante: Edit -> Component: bv (arbitrary behavioral voltage source) Value: V=V(in)*V(VCO_out) 2.
Un écart temporel entre deux sorties proportionnel à la différence de phase entre les deux entrées. On peut distinguer qui plus est, les dispositifs qui détectent les écarts de phase. les dispositifs qui détectent les écarts de phase et les écarts de fréquence. les dispositifs qui comparent des signaux d'entrée analogiques et digitaux. les dispositifs qui comparent des signaux digitaux en entrée uniquement. Théorie de fonctionnement Fonction de transfert d'un comparateur de phase. La fonction de transfert du comparateur de phase a pour caractéristiques: Un gain UP pour une différence de phase positive. Un gain DOWN pour une différence de phase négative. Une zone pour laquelle la sortie est constante quelle que soit la différence de phases en entrées: c'est la zone morte du comparateur. Une erreur de détection systématique. Par exemple dans le cas parfait pour une erreur de phase nulle, la sortie est à zéro, mais dans un cas pratique, pour une erreur de phase nulle, il y a une petite tension résiduelle en sortie: c'est l'erreur de détection systématique.
Or, le récepteur a besoin de l'horloge bit pour reconstituer correctement le train numérique (opérations de décodage et désembrouillage en particulier). La récupération du rythme est donc une fonction primordiale pour la réussite d'une liaison numérique. Une des solutions est l'utilisation d'une DPLL. Bien souvent, la DPPL est "cachée" dans les circuits intégrés "tout fait", spécialisés télécom... C. PRINCIPE Oubliez tout de la classique PLL analogique ou presque. A part la finalité, le principe de fonctionnement est totalement différent et entièrement numérique. La théorie est très complexe; Nous nous contenterons donc de donner ici une approche simplifiée mais suffisante pour comprendre et savoir utiliser un tel circuit. Une PLL numérique est en fait constituée de circuits exclusivement numériques compteur, décompteur, comparateur de phase... Elle est destinée essentiellement à la récupération d'horloge binaire à partir d'un signal numérique de fréquence bit Fb, sérialisé et codé manchester par exemple.
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Par contre, si les signaux d'entrée ne sont pas symétriques, par exemple avec un rapport cyclique différent de 50%, alors la gamme de détection est réduite. Par exemple, pour un signal d'entrée de rapport cyclique faible, 5% par exemple, la gamme de détection devient seulement 5*(2pi) / 100. Ce système est un détecteur de phase, mais pas un détecteur de fréquence.
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